[請益] Design Verification 有相關的入門書嗎!?

各位科技板上的大大你們好... 小弟是剛步入社會沒多久的菜鳥一隻.. 日前有幸錄取了驗證工程師一職... 不過小弟本身是電路設計出身.. 對於 SystemVerilog 跟 UVM 可說是完全沒有接觸過... 所以想請教一下板上的大大們.. 有沒有推薦的關於 Design Verification 的入門書可供學習及參考!? 謝謝^^ -- ◣ ◢ HEY~~~HEY~~~CHAAAAARLIE~! 　 。。。。。 ◢ ▁ ◣ ⊙ ⊙ ⊙ .◣ ▼▼▼▼ ㄟ◥ ㄧ◤ \▲▲▲▲ φ ◢ . \ . δ ◥▄▄◤ ( ︶ . by [email protected] -- ◆ From: 36.230.120.16
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推 macrady520:請問您錄取哪一間?? 02/10 22:27

推 happynesssyc:原PO超強 是某大外商 02/10 22:38

推 TripleC:Chris spear systemverilog for verification 02/11 05:47

→ TripleC:UVM 去 verification academy 網站 02/11 05:49

推 ist123:借本文一用 請問這個工作到底是在做甚麼的呢? 版上資料少 02/11 17:23

→ ist123:感謝大大指導 02/11 17:23

→ x0315x:感謝三樓大大的提供 02/11 21:14

→ stkeiko:寫pattern找IC的bug 02/11 23:14